尔雅数字电路与逻辑设计_6课后答案(学习通2023完整答案)
74 min read尔雅数字电路与逻辑设计_6课后答案(学习通2023完整答案)
数制与码制章节单元测验
1、尔雅能够表示任意一个三位十进制数至少需要（ ）位二进制数。数字设计
A、电路答案8
B、逻辑9
C、课后10
D、学习11
2、通完十进制数127.25对应二进制数为( )。整答
A、尔雅1111111.01
B、数字设计1000000010
C、电路答案111110.01
D、逻辑1100011.11
3、课后十进制数28.43的学习余3BCD码是( )。
A、通完00111000.01000011
B、01011011.01110110
C、01101100.10000111
D、01111101.10011000
4、数字信号是在数值上和时间上都是不连续的,( )是数字信号的典型代表。
A、正弦波
B、三角波
C、矩形波
D、尖峰波
5、在数字电路和计算机中,只用( )个符号来表示所有信息。
A、1
B、2
C、3
D、4
6、将二进制、八进制和十六进制数转换为十进制数的共同规则是( )。
A、除以10看余数
B、乘以十看向高位的进位
C、按权展开
D、以上均可
7、以下关于格雷码的特点描述正确的是 ( )
A、相邻2个代码之间只有1位不同
B、相邻2个代码之间有2位不同
C、相邻2个代码之间有3位不同
D、相邻2个代码之间有4位不同
8、负零的补码表示为（ ）
A、1 00…00
B、0 00…00
C、0 11…11
D、1 11…11
9、相同位数的下列进制，（）表示的数值范围最大。
A、二进制
B、八进制
C、十进制
D、十六进制
10、以下不属于二进制优点的是（）。
A、易于电路表达
B、二进制数字装置所用元件少,电路简单、可靠
C、基本运算规则简单, 运算操作方便
D、表示的数据范围大
11、16进制表示中第i位的位权是16.
12、常用的26个英文字符的大小写在计算机中是用其8421BCD码来表示的。
13、两个数相减一定不会产生溢出现象。
14、周围环境的温度属于模拟量。
15、BCD码是指以二进制形式表示的十进制数。
16、4位二进制数原码是0101，其补码是：
17、4位二进制数原码是1101，其补码是： 。
18、(11.25)H =( )B
19、(11.25)H = ( )D
20、判断两个符号相同的二进制数相加会产生溢出的依据是： 。
第三周 逻辑代数基础2
逻辑代数基础章节单元测验
1、函数F=AB+BC+AC与P=A?B?+B?C?+A?C?( )
A、相等
B、互为反函数
C、互为对偶式
D、答案都不正确
2、逻辑函数F=(A+BC?)?(A+B),当ABC的取值为( )时,F=1。
A、000
B、011
C、101
D、111
3、函数F=((A+B)?+(B+C)?+(C+A)?)?是最简( )表达式。
A、与非与非
B、与或非
C、或非或非
D、或与
4、n个变量可以构成( )个最小项。
A、n
B、2×n
C、
D、
5、标准或与式是由( )构成的逻辑表达式。
A、最大项之积
B、最小项之积
C、最大项之和
D、最小项之和
6、根据对偶规则，已知等式A(B+C)=AB+AC成立，则等式A+BC=(A+B)(A+C) ( ).
A、必然成立
B、必然不成立
C、不确定是否成立
D、以上都不正确
7、在逻辑函数中，对于变量的任一组取值，任意两个最小项的乘积为（ ）；对于变量的任一组取值，全体最小项之和为（ ）。
A、0,0
B、0,1
C、1,0
D、1,1
8、函数F=AB+A?C+B?C+C?D+D?的最简与或式为( )。
A、1
B、0
C、AB
D、AB+D
9、能使逻辑函数F=(A+B+C?)(A+B?+C)(A?+B+C)为零的变量(顺序为ABC)组合是（ ）
A、011,110,101
B、010,001,100
C、110,101,011
D、110,101,111
10、下列函数中,( )式是函数Z=AB?+AC的最小项表达式。
A、Z=AB?C+ABC+A?BC?
B、Z=AB?C+A?B?C+ABC
C、Z=AB+BC+AC
D、Z=ABC+AB?C+AB?C?
11、能使逻辑函数F=均为1的输入变量组合是( )。
A、1101,0001,0100,1000
B、1100,1110,1010,1011
C、1110,0110,0111,1111
D、111,1001,1010,0000
12、标准与或式是由( )构成的逻辑表达式。
A、最大项之积
B、最小项之积
C、最大项之和
D、最小项之和
13、函数F=AB+BC，使F=1的输入ABC组合为（ ）
A、000
B、010
C、101
D、110
14、L=AB+C的对偶式为（ ）
A、A+BC
B、(A+B)C
C、A+B+C
D、ABC
15、函数F（A,B,C）=AB+BC+AC的最小项表达式为（）
A、F（A,B,C）=∑m(0,2,4)
B、F（A,B,C）=∑m(3,5,6,7)
C、F（A,B,C）=∑m(0,2,3,4)
D、F（A,B,C）=∑m(2,4,6,7)
16、对任一逻辑式 Y，若将其中所有的与换成或，或换成与，0 换成 1 ，1 换成 0，原变量换成反变量，反变量换成原变量，则得到的结果就是Y的对偶式 。
17、相邻最小项是指只有 1个变量不同的最小项。
18、在逻辑函数中,约束项是不可能或不允许出现的变量取值组合，其值总是等于 1。
19、逻辑变量的取值，1比0大。
20、因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。
21、根据对偶规则，如果2个逻辑式相等，则他们的对偶式不一定相等。
22、根据对偶规则，如果2个逻辑式相等，则他们的对偶式一定相等。
23、在逻辑函数中，对于变量的任一组取值，全体最大项之积为1。
24、相邻最小项是指只有 个变量不同的最小项。
25、将逻辑函数中约束项和任意项统称为 。
26、在逻辑函数中,约束项是不可能或不允许出现的变量取值组合，其值总是等于 。
27、在逻辑函数中，对于变量的任一组取值，任意两个最大项之和为 。
28、卡诺图即变形的真值表，它的特点是逻辑相邻项在几何位置上也 。
29、在逻辑函数中，对于变量的任一组取值，任意两个最小项的乘积为 。
30、合并最小项的规则是相邻八格中的最小项之和可以合并为1项并消去 个因子，合并后的结果只剩下公共因子。
第四周 门电路
门电路章节单元测验
1、下列门电路工作速度快是其主要特点的是（ ）。
A、TTL
B、CMOS
C、NMOS
D、PMOS
2、输出端可直接连在一起实现“线与”逻辑功能的门电路是（）
A、或非
B、OC
C、三态
D、与或非
3、为实现数据传输的总线结构，要选用（）门电路。
A、或非
B、OC
C、三态
D、与或非
4、对TTL与非门多余输入端的处理，不能将它们（）。
A、与有用输入端连在一起
B、悬空
C、接正电源
D、接地
5、工作时必须外接电源和电阻的逻辑门电路是（ ）。
A、或非门
B、与非门
C、三态门
D、漏极开路门
6、其逻辑功能相当于双向模拟开关的逻辑门是（ ）。
A、或非门
B、OC门
C、传输门
D、三态门
7、当三态门输出高阻状态时，输出电阻为（ ）
A、无穷大
B、约100欧姆
C、无穷小
D、约10欧姆
8、功耗比较大，是以下哪种门电路的主要缺点。（ ）。
A、TTL
B、CMOS
C、NMOS
D、PMOS
9、以下哪种器件适合用TTL门电路构成。（ ）
A、内存
B、硬盘
C、优盘
D、高速缓存
10、关于数字电路中驱动门G1和负载门G2之间电压和电流关系描述正确的是（ ）。
A、G1输出高电平的下限值 VOH(min)大于等于G2输入高电平的下限值 VIH(min)
B、G1输出高电平的下限值 VOH(min)小于等于G2输入高电平的下限值 VIH(min)
C、G1输出低电平的上限值 VOL(max)大于G2输入低电平的上限值 VIL(max)
D、G1输出低电平的上限值 VOL(max)小于等于G2输入高电平的下限值 VIH(min)
11、漏极开路的门电路可以将输出端直接接在一起实现线与功能，漏极开路的门门电路在工作时必须要将输出端经下拉电阻接到地上。
12、OD门的中文含义是集电极开路门电路。
13、数字电路中，驱动门的输出低电平最大值VOLmax与负载门G2输入低电平最大值VILmax的关系应满足 VOLmax ≤ VILmax 。
14、数字电路中，驱动门的灌电流是指其输出高电平时的电流。
15、数字电路中，驱动门的拉电流是指其输出低电平时的电流。
16、CMOS集成电路最突出的优点在于功耗极低，所以非常适合制作大规模集成电路。
17、数字电路中的正逻辑是指用1 表示高电平，用0 表示低电平。
18、TTL电路是电压控制器件。
19、CMOS电路是电流控制器件。
20、在数字电路设计中， TTL和CMOS两种器件混合使用，可以直接连接使用。
21、用门电路可以直接驱动显示器件。
22、TTL器件输入引脚悬空相当于输入低电平。
23、漏极开路的门电路可以将输出端直接接在一起实现 功能，
24、漏极开路的门门电路在工作时必须要将输出端经 接到电源上。
25、OD门的中文含义是 。
26、OC门的中文含义是 。
27、电路中采用正逻辑，用 表示 高电平。
28、电路中采用正逻辑，用 表示低电平。
第六周 组合逻辑电路2
组合逻辑电路章节单元测验
1、在二进制译码器中,若输入有4位代码,则输出有( )个信号。
A、2
B、4
C、8
D、16
2、用高电平为输出有效的译码器，实现组合逻辑函数电路时还需要( ).
A、与非门
B、或非门
C、与门
D、或门
3、在下列电路中,只有( )属于组合逻辑电路。
A、触发器
B、计数器
C、数据选择器
D、寄存器
4、在组合逻辑电路的常用设计方法中,可以用( )来表示逻辑抽象的结果。
A、真值表
B、状态表
C、状态图
D、特性方程
5、组合逻辑电路的竞争-冒险是由于( )引起的。
A、电路不是最简
B、电路有多个输出
C、电路中存在延迟
D、电路使用不同的门电路
6、只考虑本位数而不考虑低位来的进位的加法称为( )。
A、全加
B、半加
C、全减
D、半减
7、用代码代表特定信号或者将代码赋予特定含义的过程称为( )。
A、译码
B、编码
C、数据选择
D、奇偶校验
8、TTL集成芯片74LS138是3/8线译码器，译码器为输出低电平有效，若输入为A2A1A0=101时，输出Y7?Y6?Y5?Y4?Y3?Y2?Y1?Y0?为（ ）。
A、00100000
B、11011111
C、11110111
D、00000100
9、一个数据选择器的地址输入端有3个时，最多可以有（ ）个数据信号输出。
A、4
B、6
C、8
D、16
10、一个64选1的数据选择器有（ ）个选择控制信号输入端。
A、6
B、16
C、32
D、64
11、用低电平为输出有效的译码器实现组合逻辑函数电路时,还需要( )。
A、与非门
B、或非门
C、与门
D、或门
12、能完成两个1位二进制数相加并考虑到低位来的进位的器件称为( )。
A、编码器
B、译码器
C、全加器
D、半加器
13、下列逻辑函数表达式中可能存在竞争冒险的是（ ）。
A、F=(A+B)(B+C)
B、F=(A?+B)(B+C)
C、F=(A+B)(B?+C)
D、F=(A+B)(B+C?)
14、半加器和输出端与输入端的逻辑关系是（ ）。
A、与非
B、或非
C、与或非
D、异或
15、能实现从多个输入端中选出一路作为输出的电路称为( )。
A、触发器
B、计数器
C、数据选择器
D、译码器
16、在组合逻辑电路中，任意时刻电路的输出只跟当前输入的有关，而与电路原来的状态无关。
17、编码器74HC148的输出信号输出选通标志有效表示编码器工作并且有有效编码信号输入 。
18、当门电路的2个输入信号同时向相同方向跳变时，由于变化的速度不一样而在输出端产生错误的尖峰脉冲，这种现象称为竞争-冒险现象。
19、异或逻辑门完成的运算也称为模2加。
20、普通编码器在任意时刻允许多个输入请求编码信号有效。
21、如果在一定条件下，逻辑函数可以简化成A+A'或AA'，则可以判定存在竞争-冒险现象。
22、将十进制数的十个数字编成二进制代码的过程叫做BCD编码。
23、八路数据分配器的地址输入端有8个。
24、组合逻辑电路的输出信号仅是输入信号的函数。
25、在组合逻辑电路中，任意时刻电路的输出只跟当前输入信号有关，而与电路原来的 无关。
26、普通编码器在任意时刻允许输入 个有效编码信号，否则输出将发生混乱。
27、在比较2个多位二进制数大小时，必须自 位到 位逐位比较。
第八周 触发器2
触发器章节单元测验
1、边沿结构的基础JK触发器是在CLK时钟的（ ）触发的。
A、上升沿
B、下降沿
C、高电平
D、低电平
2、T触发器中，当T=1时，触发器实现（ ）功能。
A、置1
B、置0
C、计数
D、保持
3、下列说法正确的是（ ）。
A、主从JK触发器没有空翻现象
B、JK之间有约束
C、主从JK触发器没有保持功能
D、主从JK触发器不能用于组成计数器。
4、锁存器或触发器的0态是指（ ）。
A、Q=0, Q?=0
B、Q=0, Q?=1
C、Q=1, Q?=0
D、Q=1, Q?=1
5、关于各种触发器的描述，下列说法错误的是（ ）。
A、触发器与锁存器的不同在于触发器增加了一个触发时钟信号。
B、电平触发的触发器只有当CLK变为有效电平是，触发器才能接受输入信号，并按照输入信号将触发器的输出置成相应状态。
C、边沿触发器的次态仅取决于时钟有效边沿到达时输入的逻辑状态。
D、脉冲触发器的次态只考虑CLK下降沿到达时输入的逻辑状态，从而决定次态的变化。
6、以下哪种类型的触发器可以直接当做SR触发器来使用（ ）。
A、D触发器
B、JK触发器
C、T′触发器
D、T触发器
7、T′触发器，当有效时钟到来时，触发器实现（ ）功能。
A、置1
B、置0
C、翻转
D、保持
8、以下不属于触发器特点的是（ ）。
A、能够存储1位二值信号
B、能根据不同的输入信号置成1状态
C、能根据不同的输入信号置成0状态
D、其存储的值的改变仅跟输入信号有关
9、同时具有保持、置0、置1和翻转功能的触发器是（ ）。
A、SR触发器
B、JK触发器
C、D触发器
D、T触发器
10、关于脉冲触发的触发器，下列说法错误的是（ ）。
A、在时钟CLK=1期间主触发器接收输入端的信号，被置成相应的状态，而从触发器不动
B、时钟CLK下降沿到来时从触发器按照主触发器状态翻转
C、在CLK=1期间主触发器有可能变化多次
D、在CLK=1期间主触发器有可翻转多次
11、主从RS触发器在CLK=1期间，RS之间不存在约束。
12、主从JK触发器在CLK=1期间，存在一次性变化。
13、T?触发器的功能是时钟脉冲每作用一次，翻转一次，因此可以作为四分频器使用。
14、由或非门构成的基本RS锁存器的约束条件是SDRD = 0 。
15、脉冲触发器比边沿触发器的的抗干扰性好。
16、触发器是一种存储单元。
17、主从JK触发器在CLK=1期间，主触发器可以实现多次翻转。
18、T?触发器的功能是时钟脉冲每作用一次，翻转一次，因此可以作为二分频器使用。
19、由与非门构成的基本RS锁存器的约束条件是SDRD = 0 。
20、脉冲触发器比电平触发器的的抗干扰性好。
21、SR锁存器在工作时是不受任何约束的。
22、时序逻辑电路在任意时刻电路的输出不仅与当前的输入信号有关，还与电路之前的 有关。
23、128k×8位的ROM有 条数据线。
24、128k×8位的ROM有 条地址线。
25、D触发器的特性方程是 。
第十一周 时序逻辑电路3
时序逻辑电路章节测验
1、8位移位寄存器可以存放( )位二进制代码。
A、4
B、8
C、16
D、256
2、构成模值为256的二进制计数器,需要( )级触发器。
A、2
B、128
C、8
D、256
3、同步计数器是指( )的计数器。
A、由同类型的触发器构成
B、各触发器时钟端连在一起,统一由系统时钟控制
C、可用前级的输出做后级触发器的时钟
D、可用后级的输出做前级触发器的时钟
4、同步清除计数器是指( )的计数器。
A、具有清除功能的同步型
B、具有清除功能的异步型
C、清除信号与时钟信号同时有效才能清除的
D、清除信号与时钟信号无关的
5、已知Q3Q2Q1Q0是同步十进制计数器的触发器输出,若以Q3作进位,则其周期和正脉冲宽度是( )。
A、10个CP脉冲,正脉冲宽度为1个CP周期
B、10个CP脉冲,正脉冲宽度为2个CP周期
C、10个CP脉冲,正脉冲宽度为4个CP周期
D、10个CP脉冲,正脉冲宽度为8个CP周期
6、若4位同步二进制加法计数器当前的状态是0111,下一个输入时钟脉冲后,其内容变为( )。
A、0111
B、0110
C、1000
D、0011
7、一个4位移位寄存器原来的状态为0000,如果串行输入始终为1,则经过4个移位脉冲后寄存器的内容为( )。
A、0001
B、0111
C、1110
D、1111
8、可以用来实现并/串转换和串/并转换的器件是( )。
A、计数器
B、移位寄存器
C、存储器
D、全加器
9、由10级触发器构成的二进制计数器,其模值为( )。
A、10
B、20
C、1000
D、1024
10、同步4位二进制减法计数器的借位输出方程是B=Q4?Q3?Q2?Q1?,则可知B的周期和正脉宽度( )。
A、16个CP周期和2个CP周期
B、16个CP周期和1个CP周期
C、8个CP周期和8个CP周期
D、8个CP周期和4个CP周期
11、若4位二进制加法计数器正常工作时,由0000状态开始计数,则经过43个输入计数脉冲后,计数器的状态应是( )。
A、0011
B、1011
C、1101
D、1110
12、设计一个能存放8位二进制代码的寄存器,需要由( )个触发器构成。
A、2
B、3
C、4
D、8
13、时序电路不含有记忆功能的器件。
14、计数器除了能对输入脉冲进行计数，还能作为分频器用。
15、移位寄存器的左移是指从低位移到高位。
16、时序电路中一定含有存储电路。
17、时序逻辑电路所谓自启动是指当电路处在无效状态时，经过几个时钟周期后能够进入到有效状态。
18、移位寄存器的右移是指从高位移到低位。
19、16个触发器构成计数器，该计数器可能的最大计数模值是。
20、在时序逻辑电路设计中，如果有2个状态在相同的输入条件下有同样的 和输出，则这两个状态是等价状态。
21、等价状态在状态化简时可以 。
22、所谓自启动是指当时序逻辑电路处在 状态时，经过几个时钟周期后能够进入到有效状态。
23、有M个状态的计数器是 进制计数器。
24、计数器的异步清零是指不需要时钟信号有效，只要异步清零端有效，输出端立即变为 。
25、计数器的异步置数是指不需要时钟信号有效，只要异步置数端有效，输出端立即 。
第十二周 半导体存储器
半导体存储器章节测验
1、随机存取存储器具有（ ）功能。
A、读/写
B、无读/写
C、只读
D、只写
2、存储容量为8K×8位的ROM存储器，其地址线为（ ）条。
A、8
B、12
C、13
D、14
3、只能按地址读出信息，而不能写入信息的存储器为（ ）
A、RAM
B、ROM
C、PROM
D、EPROM
4、2K×16b的存储器芯片，其存储容量有（ ）。
A、2000B
B、4000B
C、2048B
D、4096B
5、计算机的层次存储系统中，主存通常采用（ ）构成。
A、DRAM
B、SRAM
C、EEPROM
D、FLASH
6、ROM存储器具有（ ）功能。
A、读/写
B、无读/写
C、只读
D、只写
7、存储容量为64K×8位的ROM存储器，其数据线为（ ）条。 A.6 B.12 C.14 D.16
A、6
B、8
C、15
D、16
8、在正常工作状态下，既可以读操作又可以写操作的存储器为（ ）。
A、RAM
B、ROM
C、PROM
D、EPROM
9、一片1K×32b的只读存储器，其存储容量有（ ）。
A、1000B
B、2048B
C、4000B
D、4096B
10、下列哪种存储器在出厂时数据已经确定了（ ）。
A、掩模ROM
B、PROM
C、EPROM
D、FLASH
11、从开关速度方面考虑，DRAM芯片比SRAM芯片速度快。
12、静态存储器的存储单元是在静态触发器的基础上附加门控管而构成的。
13、从制造工艺上考虑，双极型的存储器比MOS型的存储器功耗低，集成度高。
14、由于DRAM的存储单元的结构非常简单，所以它所能达到的集成度远高于SRAM。
15、EPROM比EEPROM具有更快的擦除改写速度。
16、128k×8位的ROM有 条数据线。
17、128k×8位的ROM有有 条地址线。
18、SRAM是 存储器。
19、DRAM是 存储器。
20、ROM是 存储器。
课程期末测试
数字电路与逻辑设计期末考试
1、正零的补码表示为（ ）
A、1 00…00
B、0 00…00
C、0 11…11
D、1 11…11
2、ASCⅡ码是一组（ ）位二进制代码。
A、4
B、6
C、7
D、8
3、逻辑函数F=A(B+C?)+(D?E)?的反函数为( )。 A.(A+BC?)(D?+E)? B.(A+BC?)(D?+E)? C.(A?+B?C)(D+E?)? D.(A?+B?C)(D?E)?
A、(A+BC?)(D?+E)?
B、(A+BC?)(D?+E)?
C、(A?+B?C)(D+E?)?
D、(A?+B?C)(D?E)?
4、根据对偶规则，已知等式(AB)?= A ?+B ?成立，则等式(A+B)?= A ?B ? ( )
A、必然成立
B、必然不成立
C、不确定是否成立
D、以上都不正确
5、函数F=((AB)? (A ?+B ?)?)?是最简( )表达式。
A、与非与非
B、与或非
C、或非或非
D、或与
6、以下关于十进制代码的编码方案中，属于无权码的是（ ）
A、8421
B、余3码
C、2421
D、5211
7、L=AB+C的对偶式为（ ）
A、A+BC
B、(A+B)C
C、A+B+C
D、ABC
8、函数F=A(B+C)+CD与P=A?C?+B?C?+A?D?的关系是( )
A、相等
B、互为反函数
C、互为对偶式
D、答案都不正确
9、对于N输入的CMOS与非门，由于输入端增加，描述错误的是（ ）
A、N个NMOS管串联
B、N个PMOS管并联
C、串联管子导通，导通电阻增加，输出低电平升高
D、串联管子导通，导通电阻增加，输出高电平降低
10、功耗比较大，是以下（ ）门电路的主要缺点
A、TTL
B、CMOS
C、NMOS
D、PMOS
11、3/8线译码器，若译码器为输出高电平有效，若输入为A2A1A0=011时，输出Y7Y6Y5Y4Y3Y2Y1Y0为（ ）
A、11110111
B、00001000
C、11111011
D、00000100
12、一个128选1的数据选择器有（ ）个选择控制信号输入端。
A、128
B、32
C、16
D、7
13、一个数据选择器的地址输入端有5个时，最多可以有（ ）个数据信号输出。
A、5
B、8
C、16
D、32
14、能实现数据分配器功能的器件是（ ）
A、数据选择器
B、译码器
C、触发器
D、计数器
15、以下触发器类型，抗干扰性最好的是（ ）
A、边沿触发器
B、脉冲触发器
C、电平触发器
D、SR锁存器
16、关于电平触发的触发器其工作特性，说法错误的是（ ）
A、如果在时钟CLK有效期间内输入信号多次发生变化，则触发器的状态也会发生多次翻转
B、在时钟CLK的边沿改变其存储的值
C、在时钟CLK为有效电平的全部时间里，输入信号的变化都将引起触发器输出端状态的变化
D、只有当时钟CLK变为有效电平时，触发器才能接受输入信号
17、时序逻辑电路中必须有（ ）. A.输入逻辑变量 B.时钟信号 C.计数器 D.编码器
A、输入逻辑变量
B、时钟信号
C、计数器
D、编码器
18、一个4位移位寄存器原来的状态为1111,如果串行输入始终为0,则经过4个移位脉冲后寄存器的内容为( )
A、0001
B、0111
C、1110
D、0000
19、若4位同步二进制减法计数器当前的状态是0111,下一个输入时钟脉冲后,其内容变为( )
A、0111
B、0110
C、1000
D、0011
20、具有同步置数功能计数器是指( )的计数器
A、具有置数功能的计数器
B、具有置数功能的异步型
C、置数信号与时钟信号同时有效才能实现置数
D、置数信号与时钟信号无关
21、构成模值为128的二进制计数器,需要( )级触发器
A、7
B、8
C、128
D、256
22、下列存储器需要定期刷新的是（ ）
A、PROM
B、SRAM
C、DRAM
D、FLASH
23、格雷码每一位的状态变化都没有规律可循。（ ）
24、两个数相加一定会产生溢出现象。（ ）
25、在逻辑函数中,约束项是不可能或不允许出现的变量取值组合，其值总是等于 0。（ ）
26、逻辑变量的取值， 0比1小。（ ）
27、TTL电路是电压控制器件。（ ）
28、CMOS电路是电流控制器件。（ ）
29、八路数据分配器的地址输入端有8个。（ ）
30、超前进位加法器的工作特点是指在输入每位的加数和被加数时，同时获得该位全加的进位信号，而无需等待最低位的进位信号。（ ）
31、同一种逻辑功能的触发器可以用不同的电路结构实现。（ ）
32、脉冲触发器比电平触发器的的抗干扰性好。（ ）
33、根据逻辑代数的吸收律，A+A?B= 。
34、根据逻辑代数的吸收律，A+AB= 。
35、256k×32位的RAM有 条数据线。
36、256k×32位的RAM有 条地址线。
37、在利用卡诺图进行逻辑函数化简时，相邻八格中的最小项之和可以合并为一项并消去 个因子，合并后的结果只剩下公共因子。
38、在逻辑函数中,约束项是不可能或不允许出现的变量取值组合，其值总是等于 。
学习通数字电路与逻辑设计_6
数字电路与逻辑设计是计算机科学中非常重要的基础知识之一，以其高效、稳定、精确的特点，在计算机中的应用非常广泛。本文将介绍学习通数字电路与逻辑设计课程的第六章内容，包括译码器、编码器、多路选择器、多路分配器、比较器等内容。
一、译码器
译码器是一种将二进制代码转换为更易于理解的形式的数字电路。常见的译码器包括BCD译码器、十进制译码器等。BCD译码器是将二进制代码转换为十进制码，比如0110转换为6；十进制译码器是将十进制码转换为显式的字符或数字，比如1010转换为A。
二、编码器
编码器是一种将输入信息转换为二进制代码的数字电路。常见的编码器包括十进制编码器、BCD编码器等。十进制编码器是将十进制数字转换为二进制代码，比如3转换为0011；BCD编码器是将十进制数转换为BCD码，比如3转换为0011。
三、多路选择器
多路选择器是一种数字电路，能根据控制信号来选择多个输入信号中的一个输出信号。常见的多路选择器包括2：1选择器、4：1选择器、8：1选择器等。2：1选择器有两个输入信号和一个控制信号，当控制信号为0时，输出第一个输入信号；当控制信号为1时，输出第二个输入信号。
四、多路分配器
多路分配器是一种数字电路，能将一个输入信号分配到多个输出信号中。常见的多路分配器包括1：2分配器、1：4分配器、1：8分配器等。1：2分配器有一个输入信号和两个输出信号，当输入信号为1时，输出第一个输出信号；当输入信号为0时，输出第二个输出信号。
五、比较器
比较器是一种能够比较两个输入信号并输出比较结果的数字电路。常见的比较器包括2比较器、4比较器等。2比较器有两个输入信号和一个输出信号，当两个输入信号相等时，输出信号为1；否则输出信号为0。
以上是学习通数字电路与逻辑设计课程第六章内容的简要介绍，希望能对大家有所帮助。
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